Zeit-Digital-Wandler speziell für teilerlose ADPLL-Anwend...
In diesem Buch wird ein neuartiger Zeit-Digital-Wandler (TDC) für eine volldigitale Phasenregelschleife (ADPLL) vorgestellt, der eine hohe Linearität und einen großen Eingangsbereich mit normalisiertem fraktionalem Ausgangscode erreicht. Die Topologie basiert auf startbaren Pseudo-Differential-Verzögerungszellen. Sie arbitriert im Format eines Gated Ring Oscillator (GRO), um das Messintervall zu verlängern. Eine Normalisierungseinheit wurde entwickelt, um den Ausgang frei zu kalibrieren und Phasenfehler für ...